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楼主: 不拘一格

FC 声音正常图象出现杂色方块的不兼容现象

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发表于 2016-6-8 16:44:45 | 显示全部楼层
不拘一格 发表于 2016-3-21 17:14
$ W9 z& B, Q2 w+ [上面我做成本最低的二极管搭电路,需要选合适的高速开关二极管,同时上下拉电阻阻值在不同的机器中也要调整 ...
4 V& `2 d  A$ A! j3 z7 w
请问楼主74HC32N_6V与74HC08N_6V是同一个芯片还是连个芯片
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发表于 2016-6-8 19:02:22 | 显示全部楼层
吐槽一下,内存oe接地正却,没有缺陷,片选cs控制输出。再一个,373也正确啊,何来冲突,只有卡带的oe端被接地,才会冲突,设计上无任何问题!fc每一个零件,每一个环节我都仔细研究了. f: L. H5 K8 }; [9 ?6 f
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 楼主| 发表于 2016-7-1 01:59:52 | 显示全部楼层
本帖最后由 不拘一格 于 2016-7-1 02:01 编辑 5 H3 z& O% b5 \
孙大师 发表于 2016-6-8 19:02* Y/ L7 c2 c4 J9 D
吐槽一下,内存oe接地正却,没有缺陷,片选cs控制输出。再一个,373也正确啊,何来冲突,只有卡带的oe端被 ...
' }1 r( y' m7 }2 H3 T: d, b
3 r2 O; P. K$ v2 `$ ^
/OE永远接地这种做法是不推荐的。% ?" |- \3 [7 g7 V5 i) u5 a1 o

) z; v# M- k* xFC的设计是“技巧精妙”与“离经判道的”。之所以这样是为了压低硬件设计成本。& F6 D9 v6 F7 V5 v, k

3 R* P# D; A% @+ Z8 Q可能FC本身没有一个完善的/OE逻辑产生电路,如果要做这样的电路,需要消耗74门,或者用cpld写一个类似总线仲裁的桥接逻辑;% y  o% a$ Y; ?. j; T& Y2 @* |' ~

1 z' d0 Z# H# a+ Z以上修改其实也是用最低成本实现避免时序的交错。
9 D* T* M( r" _; h( ^0 N* R
. ?3 T9 h$ R' p0 y理论的/OE时序信号,可以参考MD,以下是MD的信号在逻辑分析仪上测量抓取的图片(图片借用他人)
7 M! u! e& p6 w5 ^

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